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机译:电流模式逻辑分频器中由器件噪声引起的时序抖动的新模型
Marko Aleksic; Nikola Nedovic; K. Wayne Current; Vojin G. Oklobdzija;
机译:50 GHz LC交叉耦合振荡器中的低功耗CMOS注入锁定和电流模式逻辑分频器
机译:MOS电流模式逻辑分频器的设计方法
机译:用于基于延迟单元的VCO和频率合成器的低相位噪声,低时序抖动设计技术。
机译:听觉传入轴突的脱髓鞘作用增加高频射击过程中动作电位正时的抖动
机译:非自治MOS电流模式逻辑电路的抖动分析
机译:逻辑电路的时序约束模型的生成方法,逻辑电路的时序约束模型的生成程序以及使用时序约束模型的时序驱动布局方法
机译:PVT稳健的Mod 3分频器的电流模式逻辑锁存器
机译:信号消除可减少相位噪声,周期抖动和本地振荡器,频率时序或其他时序发生器或信号源中的其他污染
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